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PDF HYB39S512xx0ATL Data sheet ( Hoja de datos )
| Número de pieza | HYB39S512xx0ATL | |
| Descripción | 512-Mbit Synchronous DRAM | |
| Fabricantes | Infineon Technologies AG | |
| Logotipo |  |
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Data Sheet, Rev. 1.3, March 2003
HYB39S512400AT(L)
HYB39S512800AT(L)
HYB39S512160AT(L)
512-Mbit Synchronous DRAM
SDRAM
www.DataSheet4U.net
Memory Products
Never stop thinking.
1 page  
HYB 39S512[40/80/16]0AT(L)
512-Mbit Synchronous DRAM
1
1.1
1.2
2
2.1
2.2
2.3
3
3.1
3.2
3.3
3.3.1
3.4
3.5
3.5.1
3.5.2
3.5.3
3.5.4
4
4.1
4.2
5
Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8
Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8
Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8
Pin Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
Signal Pin Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10
Package P-TSOPII-54 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11
Block Diagrams . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 12
Functional Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15
Operation Definition . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15
Initialization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16
Mode Register Definition . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16
Burst Length . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
Commands . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
Operations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
Read and write . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
DQM Function . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20
Suspend Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20
Power Down . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20
Electrical Characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
Operating Conditions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
AC Characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24
Package Outlines . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
www.DataSheet4U.net
Data Sheet
5 Rev. 1.3, 2004-03
5 Page 
HYB 39S512[40/80/16]0AT(L)
512-Mbit Synchronous DRAM
Pin Configuration
Table 3 Signal Pin Description
Pin Type Signal Polarity Function
DQM
LDQM
UDQM
Input
Pulse Active
High
Data Mask
The Data Input/Output mask places the DQ buffers in a high impedance
state when sampled high. In Read mode, DQM has a latency of two clock
cycles and controls the output buffers like an output enable. In Write mode,
DQM has a latency of zero and operates as a word mask by allowing input
data to be written if it is low but blocks the write operation if DQM is high.
One DQM input is present in x4 and x8 SDRAMs, LDQM and UDQM
controls the lower and upper bytes in x16 SDRAMs.
VDD VSS Supply –
–
Power and Ground
Power and ground for the input buffers and the core logic (3.3 V)
VDDQ VSSQ Supply –
–
Power and Ground for DQs
Isolated power supply and ground for the output buffers to provide
improved noise immunity.
NC – – – Not Connected
No internal electrical connection is present.
2.2 Package P-TSOPII-54
www.DataSheet4U.net
32M x 16
64M x 8
128M x 4
VDD VDD VDD
DQ0 DQ0 NC
VDDQ VDDQ VDDQ
DQ1 NC NC
DQ2 DQ1 DQ0
VSSQ VSSQ VSSQ
DQ3 NC NC
DQ4 DQ2 NC
VDDQ VDDQ VDDQ
DQ5 NC NC
DQ6 DQ3 DQ1
VSSQ VSSQ VSSQ
DQ7 NC NC
VDD VDD VDD
LDQM NC NC
WE WE WE
CAS CAS CAS
RAS RAS RAS
CS CS CS
BA0 BA0 BA0
BA1 BA1 BA1
A10/AP A10/APA10/AP
A0 A0 A0
A1 A1 A1
A2 A2 A2
A3 A3 A3
VDD VDD VDD
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
54 VSS VSS VSS
53 NC DQ7 DQ15
52 VSSQ VSSQ VSSQ
51 NC NC DQ14
50 DQ3 DQ6 DQ13
49 VDDQ VDDQ VDDQ
48 NC NC DQ12
47 NC DQ5 DQ11
46 VSSQ VSSQ VSSQ
45 NC NC DQ10
44 DQ2 DQ4 DQ9
43 VDDQ VDDQ VDDQ
42 NC NC DQ8
41 VSS VSS VSS
40 NC NC NC
39 DQM DQM UDQM
38 CLK CLK CLK
37 CKE CKE CKE
36 A12 A12 A12
35 A11 A11 A11
34 A9 A9 A9
33 A8 A8 A8
32 A7 A7 A7
31 A6 A6 A6
30 A5 A5 A5
29 A4 A4 A4
28 VSS VSS VSS
TSOPII-54 (400 mil x 875 mil, 0.8 mm pitch)
Figure 1 PinoutP-TSOPII-54
Data Sheet
11
Rev. 1.3, 2004-03
10082003-L1GD-PVI5
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Hoja de datos destacado
| Número de pieza | Descripción | Fabricantes |
| HYB39S512xx0ATL | 512-Mbit Synchronous DRAM | Infineon Technologies AG |
| Número de pieza | Descripción | Fabricantes |
| SLA6805M | High Voltage 3 phase Motor Driver IC. |
 Sanken |
| SDC1742 | 12- and 14-Bit Hybrid Synchro / Resolver-to-Digital Converters. |
 Analog Devices |
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